文章由Mike LaBonte撰写

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即将推出:使用IBIS 7.0更容易的信号完整性模拟设置

曾经有一段时间,数字集成电路之间的信号完整性几乎可以通过以下一个简单的规则来保证:在任何单个输出引脚上连接的输入引脚不要超过最大数量。通常扇形的极限在7左右。没有模型,没有模拟。我们需要的一切都在书架上塞满了厚厚的供应商数据表,这是美国在线安装光盘的杀树病毒前身。啊,那是过去的日子!


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